伴随着灵巧方式的创建提升了生产主力和品质,业内针对硬件配置设计的兴趣爱好已经提高。
即便如此,大家广泛认为硬件配置行业的取得成功依然是比较有限的。实际很有可能比想像好些一些,由于硬件配置中的一些灵敏性发展趋势沒有确立标识。
比如,大家见到愈来愈多的勤奋将 IP 级设计和验证与 SoC 级设计和验证分离出来。在这类状况下,不一样的 IP 精英团队都从 SoC 新项目的“火车实体模型”内以多线程的方法运作,当进行 SoC 设计时能够挑选一切版本号的 IP。
尽管这类方式沒有被贴上灵巧的标识,但这类方式的确合乎灵巧哲学思想。
灵巧设计发展趋势的较大 摩擦阻力 —— 算率
集成ic流片的高成本费和流片后没法变更设计一般被觉得是灵巧方式不可以非常好地投射到硬件配置设计的重要缘故。可是,流片后没法灵巧并不一定代表着我们不能在流片前更为灵巧。
在硬件配置设计中选用灵敏性设计较大 摩擦阻力之一是硬件配置验证的多元性。测试软件系统只必须实行该程序流程需要的计算,自然测试会飞速运作。
测试硬件配置设计必须一个手机模拟器程序流程,该程序流程能够在手机软件中模拟芯片设计在硬件配置中生产制造时的个人行为。这一手机模拟器程序流程的计算十分价格昂贵,但其实行速率比它已经仿真模拟的真正集成ic的速度比较慢数千倍。
设计硬件配置的企业在测试其设计的时候会遭受计算工作能力的限定。几个终端软件设计的企业都给予独特的模拟仿真网络加速器,他们应用专为模拟仿真加快而设计的专用型CPU或 FPGA。这种系统软件的仿真模拟速率比通用性网络服务器上的仿真模拟快数百倍,他们的成本费也相对应地更为价格昂贵。因而,设计精英团队发觉她们在这种服务平台上的计算資源一样比较有限。
灵巧设计必须持续集成和测试,不但是模块等级,全部系统软件等级一样这般。假如测试受制于计算工作能力,那麼灵巧设计必须高些的计算高效率,尤其是在系统软件等级。比如,一个典型性的当代 SoC 必须在数千台设备的网络服务器群上开展长达五天的持续计算来进行一组基本上的详细集成ic测试。
在这般极端化的计算情况下,设计精英团队怎样才可以让集成ic设计越来越更为灵巧?
处理灵巧计算挑戰的2个方式
有两个重要方式能够促进处理灵巧硬件配置设计中的计算阻碍:根据参数化降低设计经营规模和根据计算货运物流,计算货运物流涉及到应用计算和高数来整体规划和执行大中型和繁杂的每日任务。计算货运物流运用于很多行业,包含货品、服务项目和有关信息从出产地到消費地的流动性和存储。)降低测试经营规模。
第一,参数化。拷贝在 SoC 设计中愈来愈广泛,不论是 IP 级拷贝(如多核 CPU),或是构架级拷贝(如 GPU 中的着色器核心或 AI 网络加速器中的 MAC 连接点)。根据运用参数化,能够在某类方式的参数化下将大量类似但不一样的事情结合在一起,进而显着提高拷贝的范畴。
设计中的拷贝越多,自动生成设计的减缩配备的概率就越大,这种配备更小但对测试依然更有意义。参数化的应用越繁杂,在 SoC 等级降到最低用以测试特殊作用的设计规格就越灵便。
System Verilog 等流行硬件配置描述语言 (HDL) 早已非常好地适用拷贝和参数化,但能够根据选用更高級的语言表达做为 HDL 制作器来进一步开启他们。比如,SystemC、Matlab、Python 或 Chisel。与分离出来 IP 和 SoC 级设计的发展趋势一样,选用程序设计语言开展硬件配置设计也发生了相近的发展趋势。
对于计算货运物流,如果我们在灵巧设计方式下持续集成和测试,那麼每一次集成化和测试全是对以前的集成化和测试的增加量。针对给出的增加量设计变更,计算逻辑性代表着全自动明确最好设计配备、测试集和测试配备,便于以最少的计算成本费给予优良的验证品质。
能够将其视作一类新的 EDA 专用工具 —— 一个模块在详细的验证步骤中操纵全部其他模块。
大家看到了根据计算货运物流提升验证计算高效率的极大发展潜力,尤其是假如希望对映异构的、根据云的将来,在普遍的仿真模拟和模拟仿真服务平台上能够对无尽应用容积开展收费。如同计算货运物流更改了 UPS 和 FedEx 等货运公司的包囊货运量一样,它还可以更改硬件配置设计中的验证货运量。
汇总
硬件配置设计早已越来越更为灵巧,但仍有非常大的改善室内空间。与手机软件验证对比,这类改善的一个重要阻碍是硬件配置验证的极大计算成本费。
根据运用拷贝、参数化和程序设计语言做为 HDL 制作器,我们可以最大限度地降低测试中的设计规格。
根据选用计算货运物流,我们可以最大限度地降低测试劳动量并进一步提升测试中的设计规格,尤其是在适用云的将来,及其根据应用无限制验证计算的易用性。
(译自 eetime,文中创作者 Paul Cunningham 是 Cadence Design Systems 系统软件和验证组的高级副总裁兼经理)
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